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硅谷纪实(四):EDA验证工具的变革和互连IP

上网日期: 2014年05月09日 ?? 作者: Yorbe Zhang ?? 我来评论 字号:放大 | 缩小 分享到:sina weibo tencent weibo tencent weibo


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关键字:EDA验证工具? IP? Mentor? Arteris?

FlexNoC是该互连IP的技术名称。

“FlexNoC也被ARM、CEVA、MIPS、Synopsys、Cadence等IP、EDA和代工厂所采用,”Shuler说,“利用FlexNoC技术可使设计时间缩短一半,由18至24个月降至9至12个月。”

硅谷纪实(四):EDA验证工具的变革和互连IP(电子工程专辑)
图13:FlexNoC技术缩短IC设计时间。

他形象地用“联合国IP”来表述该IP的生态链:IP公司、EDA公司、以至相应的标准。

一些主要的技术特性:FlexNoC实现了低功耗,在采用40nm工艺时,每1百万门的待机功耗小于1mW;工作频率超过1GHz;零延迟,其是该公司正在申请专利的技术;在布线方式上实现了优化,以缩短布线长度。

图14给出了FlexNoC与混合总线互连的比较。

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图14:FlexNoC的技术特性总结。

在媒体发布会上,Shuler也宣布了Arteris向创意电子(GUC)的授权,把FlexNoC互连IP用于GUC 16nm SoC IP验证平台。

“使用FlexNoC互连IP作为IC片上通信骨干网络,就可以连接SoC上的几十个或几百个IP块。”Shuler总结到,“在SoC参考设计平台的基础上设计衍生系统芯片是我们的强项。”

本次媒体发布会完全由Arteris主导,并未提及媒体曾报道的高通于2013年未收购Arteris一事,在高通英文官网也未发现相关新闻稿件。

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