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卓联针对宽带应用推出数字时钟DPLL芯片

上网日期: 2004年11月25日 ?? 我来评论 字号:放大 | 缩小 分享到:sina weibo tencent weibo tencent weibo


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关键字:zarlink semiconductor? 卓联半导体? DPLL芯片? ZL30109?

卓联半导体公司日前推出一款DPLL芯片——ZL30109。该芯片可为宽带设备提供更高的灵活性和电信级性能。ZL30109芯片是一款单片硅器件,适合应用于高速终端产品和接入网络设备,包括数字用户线接入多路复用器(DSLAM)、VoIP网关和IP-PBX。作为中央时钟器件,该芯片可接受多种频率的参考时钟,包括附加的2kHz帧脉冲和19.44MHz时钟,从而满足各种应用场合。

ZL30109芯片采用与卓联的整个T1/E1 DPLL系列兼容的引脚形式,补充了卓联模拟时钟倍频器PLL产品组合。该器件具备参考时钟监测等多种特性,抖动性能优于0.5ns,符合Stratum 4/4E要求,同时还提供19.44MHz SONET/SDH频率。

ZL30109与今年早些时候发布的ZL30100和ZL30101 DPLL器件引脚兼容。新的芯片可产生极为稳定可靠的时钟,允许设计者利用同一电路板设计迅速从Stratum 4/4E迁移到Stratum 3时钟。全部特性和模式均可通过硬件进行选择,减少了对复杂的软件驱动程序或外部微处理器的需求。

ZL30109可接受两路参考时钟输入,可自动同步到工作在2kHz、8kHz、1.544MHz、2.048MHz、8.192MHz、16.384MHz或19.44MHz频率的时钟上。该器件采用卓联独有的抖动处理技术抑制输入时钟的抖动,并能输出下列频率的时钟:2kHz、8kHz、1.544MHz、2.048MHz、4.096MHz、8.192MHz、16.384MHz、32.768MHz、65.536MHz和 19.44MHz。

如果网络同步时钟源暂时丢失,ZL30109器件将自动切换到保持模式,并根据从过去参考信号中采集的数据继续产生输出时钟,可为Stratum 4/4E系统提供0.15ppm (百万分之一)的保持性能。卓联DPLL符合Telcordia GR-1244-CORE针对Stratum 3/4/4E、ITU-T G.823、G.824和G.813选项1、以及美国国家标准协会(ANSI) T1.403要求。

ZL30109 DPLL芯片现已批量生产,它采用10×10mm 6?引脚薄型四方扁平封装(TQFP)封装,千片批量时的单价为13.50美元(仅供参考)。






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