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计数器竞争冒险问题

发布时间:2010-5-20 下午10:21

作者: funcye

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我是Verilog HDL 语言的初学者。
我写出了下面这个分频器 但是,我发现,每当CNT从奇数到偶数变化的时候,就会出现一个意想不到的数据
这应该是竞争冒险问题吧。
下面附上波形仿真图。希望高手解答下。谢谢了
module fenp10(cnt,out,clk,reset);
??? input clk , reset ;
?? ?output out ,cnt;
??? wire clk , reset ;
?? ?reg out;
??? reg[3:0] cnt;

always @(posedge?clk) begin
??? if (reset) cnt <= 0 ;
??? else cnt <= cnt + 1 ;
??? if (cnt <= 7) out <= 1 ;
????else out <= 0 ;
end

endmodule
Mike_GS 编辑于 2010-5-21 上午10:37
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电子工程专辑骑着公共电动单车游巴黎!
第1楼

回复主题:计数器竞争冒险问题

发布时间:2010-5-25 上午8:20

作者: sl6606

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第2楼 回复主题:计数器竞争冒险问题 发布时间:2010-5-25 上午8:20

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第3楼 回复主题:计数器竞争冒险问题 发布时间:2010-5-25 上午8:20

作者: sl6606

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第4楼 回复主题:计数器竞争冒险问题 发布时间:2010-5-25 上午9:14

作者: 中岛

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第5楼 回复主题:计数器竞争冒险问题 发布时间:2010-5-25 上午9:14

作者: 中岛

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第6楼 回复主题:计数器竞争冒险问题 发布时间:2010-5-25 下午5:50

作者: Mike_GS

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全广告,高手呢?

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电子工程专辑Type C接口设备横行,你需要一款Hub控制器
第7楼 回复主题:计数器竞争冒险问题 发布时间:2010-6-2 上午2:00

作者: 明火麒麟

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写广告的哪些骇人就不会答答问题!
问题贴!不能沉,帮顶

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电子工程专辑2016年Q1摄像头芯片出货量排名,第一是家中国厂商
第8楼 回复主题:计数器竞争冒险问题 发布时间:2010-6-4 下午4:12

作者: Mike_GS

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是的,问题没解决就不能沉。

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第9楼 回复主题:计数器竞争冒险问题 发布时间:2010-6-4 下午5:35

作者: flyhome

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你这是PAR仿真吧,问题是你的设计没有加上timeconstraint使得满足200MHz工作的条件,你可以先把频率改小试试

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第10楼 回复主题:计数器竞争冒险问题 发布时间:2010-9-16 下午9:53

作者: 1257160361511

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我个人感觉是你时序约束的问题,如直接下到板子上看或许就没了

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第11楼 回复主题:计数器竞争冒险问题 发布时间:2011-12-15 下午8:55

作者: 我不象我

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换个计数器设计方法吧,如果资源够得话

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请教:Altera FPGA...????下一帖??

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