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计数器 上电脉冲消除问题

发布时间:2014-1-10 下午12:12

作者: Lancelod

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如图所示,希望通过与非门产生的脉冲作为计数进位信号,但是有一个问题,在上电的时候,由于U5的CLK会由默认0跳变到U4:A的输出1,误触发了CLK,导致进位计数比实际数值大1(如下图,下方是进位数码管),想问问各位,怎么消除这个上电的脉冲?




PS:74LS161是16进制计数器,我知道160可以直接做10进制,此处还请各位就事论事吧,新的结构和添加器件都可以,但是更换芯片暂时先不考虑。
谢谢各位!

?
小编Ana 编辑于 2014-1-13 上午10:09
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第1楼

回复主题:计数器 上电脉冲消除问题

发布时间:2014-1-13 下午3:42

作者: 小麻

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对于数字电路来说,如果是上电的问题,一般都是利用上电使能功能,延迟主逻辑IC的工作时间,使其他器件上电正常后,才进入功能,相当于设计一个延迟reset信号,而且这个reset信号通常还与电压门限监测电路连接,防止上电或掉电时,电压不稳时已经进入工作状态。
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第2楼 回复主题:计数器 上电脉冲消除问题 发布时间:2014-1-14 上午7:49

作者: 大宝小莉啊

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第3楼 回复主题:计数器 上电脉冲消除问题 发布时间:2014-1-14 上午10:02

作者: 海阔凭鱼跃

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樓主的方案在進位時輸出端Q1、Q3會有一個尖脉衝,解決方案:將74LS161的D0~D3全部接地,MR腳接上電延時電路的輸出,Q0、Q3接與非門的輸入,與非門的輸出接到同一芯片的LOAD,同時作為進位信號接到下一個74LS161的CLK。
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第4楼 回复主题:计数器 上电脉冲消除问题 发布时间:2014-1-16 上午11:35

作者: Lancelod

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多谢回复,本人有点愚笨,正是上电延迟的RESET电路部分不知道如何设计,还请指教。

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第5楼 回复主题:计数器 上电脉冲消除问题 发布时间:2014-1-16 上午11:36

作者: Lancelod

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Q0 Q3接与非门输入的话就不是10进制计数器了,同问上电延时电路应该如何设计呢?

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第6楼 回复主题:计数器 上电脉冲消除问题 发布时间:2014-1-17 下午1:18

作者: 小麻

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确实没时间画图了,就简单的口述一下: 例如:解决U4A的输出信号,因为该信号实际控制主计数芯片的MR管脚,是低电平有效,因此可以将该信号切断,串接一个二输入的与门,与门的多出来的一个输入脚,上拉一个电阻,下拉一个电容,构成RC充电延时电路,这样上电时,由于RC的作用,该与门的这个输入脚保持在0电平,那么输出也一致保持0电平,U4A的输出信号则无效。在上电完成后,该输入脚变为高电平,此时U4A信号将直通控制,跟以前电路一样。 需要指出的时,如果需要解决这个问题,U4B也应该采用同样的方法处理。

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第7楼 回复主题:计数器 上电脉冲消除问题 发布时间:2014-1-28 上午9:18

作者: smilly

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如果楼主能够确定是由于U4A在上电时由低到高的跳变引起的问题,可以在U4A与U5之间增加一个反相器(如果U4还有多余的与非门,就不需要单独增加非门了),改变跳变的方向,防止U5上电时计数。

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第8楼 回复主题:计数器 上电脉冲消除问题 发布时间:2014-2-8 下午5:27

作者: ericko

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最簡單的作法只需ENT或ENP切開加一電阻道VCC加一電容到GND算好DELAY 時間即可如擔心放電問題可並一放電二級管於電阻上

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第9楼 回复主题:计数器 上电脉冲消除问题 发布时间:2014-2-11 下午5:32

作者: pslele@sweda.co...

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赞一个,低电平有效,上拉电阻来控制即可。

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与?上电脉冲,74ls161,74ls00,数码管,计数器?相关的话题
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